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众所周知，FPGA能够利用高度并行结构在单个时钟周期内完成复杂算法。目前的FPGA在单个器件内能够提供每秒数百上千（MSPS）和每秒数十亿乘法累加操作（GMACS）的性能。拥有如此高的DSP性能水平，设计人员可以选择降低FPGA的时钟速率来节省功耗，也可以选择实现更多通道来降低系统成本并降低材料清单成本（BOM）。

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